Veröffentlichungen
Veröffentlichungen:
204 Einträge
2011
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IP Porting and Resizing for High-Speed NoC Links from 65nm to 28nm Globalfoundries CMOS Technology with WiCkeD , 1 Dez. 2011, MunEDA User Group MeetingElektronische (Volltext-)VersionPublikation: Beitrag in Buch/Konferenzbericht/Sammelband/Gutachten > Beitrag in Konferenzband
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Mismatch Characterization of High-Speed NoC Links using Asynchronous Sub-Sampling , 1 Dez. 2011, IEEE International Symposium on System on Chip. S. 112-115, 4 S.Elektronische (Volltext-)VersionPublikation: Beitrag in Buch/Konferenzbericht/Sammelband/Gutachten > Beitrag in Konferenzband
2010
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Exploration of Feasible Voltage Ranges in Analog CMOS Circuits Using Linearized-Operating-Point Transistor Models , 1 Dez. 2010, MunEDA User Group MeetingElektronische (Volltext-)VersionPublikation: Beitrag in Buch/Konferenzbericht/Sammelband/Gutachten > Beitrag in Konferenzband
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Highly Integrated Packet-Based AER Communication Infrastructure with 3Gevent/s Throughput , 1 Dez. 2010, 2010 17th IEEE International Conference on Electronics, Circuits and Systems. IEEE Xplore, S. 952-955, 4 S.Elektronische (Volltext-)VersionPublikation: Beitrag in Buch/Konferenzbericht/Sammelband/Gutachten > Beitrag in Konferenzband
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Using neuron dynamics for realistic synaptic learning , 1 Dez. 2010, The Neuromorphic EngineerElektronische (Volltext-)VersionPublikation: Beitrag in Buch/Konferenzbericht/Sammelband/Gutachten > Beitrag in Konferenzband
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Efficient compensation of delay variations in high-speed network-on-chip data links , 1 Sept. 2010, IEEE International Symposium on System on Chip (SoC). S. 55-58, 4 S.Elektronische (Volltext-)VersionPublikation: Beitrag in Buch/Konferenzbericht/Sammelband/Gutachten > Beitrag in Konferenzband
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Low Power Design of the X-GOLD® SDR 20 Baseband Processor , 1 März 2010, Proceedings of Design, Automation and Test in Europe (DATE 2010)Elektronische (Volltext-)VersionPublikation: Beitrag in Buch/Konferenzbericht/Sammelband/Gutachten > Beitrag in Konferenzband
2007
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Nearest Neighborhood Greyscale Operator for hardware-efficient micro-scale texture extraction , 1 Dez. 2007, in: EURASIP journal on advances in signal processing. Vol. 2007, S. Article ID 52630Publikation: Beitrag in Fachzeitschrift > Forschungsartikel
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Neighborhood Rank Order Coding for Robust Texture Analysis and Feature Extraction , 1 Dez. 2007, Proceedings of 7th International Conference on Hybrid Intelligent Systems HIS 2007. S. 290-295, 6 S.Elektronische (Volltext-)VersionPublikation: Beitrag in Buch/Konferenzbericht/Sammelband/Gutachten > Beitrag in Konferenzband
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Abbildung komplexer, pulsierender, neuronaler Netzwerke auf spezielle neuronale VLSI Hardware , 1 Juni 2007, Dresdner Arbeitstagung Schaltungs- und Systementwurf (DASS´2007). S. pp. 127-132Publikation: Beitrag in Buch/Konferenzbericht/Sammelband/Gutachten > Beitrag in Konferenzband