2005
VOGELSANG, S.; SPALLEK, R. G.; SONNTAG, F.; KLOTZBACH, U.:
Modellierung, Dimensionierung und Optimierung des Mikro-Fluidikdesigns für Proteinchips zum Nachweis geringster Konzentrationen.
In: Dresdner Sensor-Symposium Beitrag 1037, TUDpress , 2005
- ISBN 3-938863-29-3
BRAUNES, J.; KÖHLER, S.; KÖNIGSMANN,A.; SPALLEK, R. G.:
Ein Zwischenformat-Profiler für das RECAST-Framework.
In: ARCS'05: Architecture of Compunting Systems 2005: Workshop on Dynamically Reconfigurable Systems, Innsbruck, Austria, March 14-17, 2005, VDE Verlag, 2005
- ISBN 3-8007-2880-X,
HATNIK, U.; HAUFE, J.; SCHWARZ, P.; SPALLEK, R. G.:
Ein Framework zur verteilten objektorientierten Simulation heterogener Kommunikationssysteme.
In: ASIM 2005,18th Symposium on Simulation Technique, Friedrich-Alexander University in Erlangen, Germany, 12.-15.9.05, SCS Publishing House, 2005,
- ISBN 3-936150-41-9
SCHOMACKER, R.; TEMMLER, D.; SPALLEK, R. G., PREUßER, T. B., RÖNSCH, T.:
Ein Simulationsmodell für die Layoutabhängigkeit der Wachstumsrate bei der selektiven Siliziumepitaxie.
In: ASIM 2005,18th Symposium on Simulation Technique, Friedrich-Alexander University in Erlangen, Germany, 12.-15.9.05, SCS Publishing House, 2005,
- ISBN 3-936150-41-9
IRRGANG, K.; BRAUNES, J.; SPALLEK, R. G.; WEISSE, S.; GRÖGER, T.:
Konfiguration komplexer Test- und Debug-Hardware in System-on-Chip.
In: Dresdner Arbeitstagung Schaltkreis- und Systementwurf-DASS'2005, Dresden, Germany, Fraunhofer-Institut für Integrierte Schaltungen, April/2005,
S. 73--78
IRRGANG, K.:
Test und Debugging von Multi-Core Systems-on-a-Chip.
In: Wissenschaftliche Beiträge der FachHochschule Lausitz, March, 2005,
ISBN: 3-9810211-0-X, S. 64--69
IRRGANG, K.; KÖHLER, S.; WEISSE, S.:
On-Chip Debug Support for Multi-Core Systems-on-a-Chip.
In: embedded world 2005 conference, February,2005, Nürnberg, Germany, DESIGN&ELEKTRONIK, WEKA Fachzeitschriften-Verlag GmbH,
S. 786--791
ZABEL, M.; KÖHLER, S.; ZIMMERLING, M.; PREUßER, T. B.; SPALLEK, R. G.:
Design Space Exploration of Coarse-Grain Reconfigurable DSPs.
In: Proceedings of the 2005 International Conference on Reconfigurable Computing and FPGAs (ReConFig'05) on Reconfigurable Computing and FPGAs, IEEE Computer Society, 2005,
ISBN:0-7695-2456-7, S.15
http://ieeexplore.ieee.org/stamp/stamp.jsp?tp=&arnumber=1592497
PREUßER, T. B.; KÖHLER, S.:
Discrete Fractional Clock Generation for Systems-on-FPGA.
In: Technische Berichte: Technische Universität Dresden, Fakultät Informatik, 2005, Nummer: TUD-FI05-07, Juni/2005,
ISSN: 1430-211X
PREUßER, T. B.; ZABEL, M.; SPALLEK, R. G.:
About Carries and Tokens - Re-Using Adder Circuits for Arbitration.
In: Proceedings of IEEE Workshop on Signal Processing Systems (SiPS 2005), IEEE Press, 2006
ISBN: 0-7803-9334-1
http://ieeexplore.ieee.org/stamp/stamp.jsp?tp=&arnumber=1579839
KOTZSCH, V.; SCHNEIDER, J.; DÖHRING, G.:
Reusable Design of Inter-Chip Communication Interfaces for Next Generation of Adaptive Computing System.
In: ARCS '05 - 18th International Conference on Architecture of Computing Systems 2005Innsbruck, Austria, March 14-17, 2005,
VOGELSANG, S.; SPALLEK, R. G.:
Architekturabhängige Optimierung von Debug-Zugängen im Zusammenhang mit Multi-Core System-on-Chip Architekturen.
In: Dresdner Arbeitstagung Schaltungs- und Systementwurf (DASS´2005), Dresden, 13. und 14. April 2005: Frauenhofer IIS, Institutsteil ESA, 2005