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01.06.2021
Yifan Yang: Design and Implementation of a Configuration Manager for a Coarse-Grained Reconfigurable Architecture for Machine Learning (Zwischenpräsentation Masterarbeit)
24.06.2021, 14:00 Uhr
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Yifan Yang: Design and Implementation of a Configuration Manager for a Coarse-Grained Reconfigurable Architecture for Machine Learning (Zwischenpräsentation Masterarbeit)
23.05.2021
Yi Han Poy: Sensordaten-Fusion von IMU und GPS-Signal (Studienarbeit)
01.06.2021, 13:00Uhr
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Yi Han Poy: Sensordaten-Fusion von IMU und GPS-Signal (Studienarbeit)
19.05.2021
Xinyue Shi: DMA Controller and Library Implementation and Integration for NoC-based RISC-V Systems (Projektarbeit)
04.06.2021, 10:00 Uhr
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Xinyue Shi: DMA Controller and Library Implementation and Integration for NoC-based RISC-V Systems (Projektarbeit)
19.05.2021
Matthias Nickel: Implementierung und Optimierung des AKAZE Feature Detection Algorithmus für die HiFlipVX Bibliothek mittels High-Level Synthese (Masterarbeit)
20.05.2021, 14:30 Uhr
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Matthias Nickel: Implementierung und Optimierung des AKAZE Feature Detection Algorithmus für die HiFlipVX Bibliothek mittels High-Level Synthese (Masterarbeit)
07.05.2021
Pascal Scholz: Porting L4Re Microkernel / Hypervisor to RISC-V (Zwischenpräsentation Forschungsprojekt)
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Pascal Scholz: Porting L4Re Microkernel / Hypervisor to RISC-V (Zwischenpräsentation Forschungsprojekt)
08.04.2021
Florian Schuster: Development of a 64-bit RISC-V based multi-core shared memory system (Studienarbeit)
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Florian Schuster: Development of a 64-bit RISC-V based multi-core shared memory system (Studienarbeit)
07.04.2021
Christoph Tietz: Realization of a 2D-Bitstream Relocation on Xilinx UltraScale+ (Präsentation Belegarbeit)
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Christoph Tietz: Realization of a 2D-Bitstream Relocation on Xilinx UltraScale+ (Präsentation Belegarbeit)
22.03.2021
Mohamed Naeim: Investigating Chisel programming language for hardware development (Projektarbeit)
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Mohamed Naeim: Investigating Chisel programming language for hardware development (Projektarbeit)
22.03.2021
Yifan Yang: RISC-V Processor Development: Cache Memory and Branch Prediction Unit (Projektarbeit)
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Yifan Yang: RISC-V Processor Development: Cache Memory and Branch Prediction Unit (Projektarbeit)
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